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FDS_6533_6534_004
71M6533/G/H and 71M6534/H Data Sheet
6.5.5
SPI Slave Port (MISSION Mode)
Table 90: SPI Slave Port (MISSION Mode) Timing
Parameter
Condition
Min
Typ
Max
Unit
t SPIcyc PCLK cycle time
t SPILead Enable lead time
t SPILag Enable lag time
t SPIW PCLK pulse width:
High
Low
1
15
0
40
40
μs
ns
ns
ns
ns
t SPISCK PCSZ to first PCLK fall
Ignore if PCLK is low
when PCSZ falls.
2
ns
t SPIDIS
t SPIEV
t SPISU
t SPIH
Disable time
PCLK to Data Out
Data input setup time
Data input hold time
0
10
5
15
ns
ns
ns
ns
PCSZ
PCLK
t SPILead
t SPIcyc
t SPILag
PSDO
t SPISCK
t SPIW
MSB OUT
t SPIEV
t SPIW
LSB OUT
t SPIDIS
t SPIH
PSDI
MSB IN
LSB IN
Figure 48: SPI Slave Port (MISSION Mode) Timing
Rev 2
117
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